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B.4. Master port 0 input and output signal timing parameters

Table B.3 shows the master port 0 input and output signal timing parameters.

Table B.3. Master port 0 inputs and outputs
Port nameTypeMaximum constraint
ARADDRM0[31:0]Output70%
ARBURSTM0[1:0]Output70%
ARCACHEM0[3:0]Output70%
ARIDM0[7:0]Output70%
ARLENM0[3:0]Output70%
ARLOCKM0[1:0]Output70%
ARPROTM0[2:0]Output70%
ARREADYM0Input50%
ARSIZEM0[2:0]Output70%
ARUSERM0[7:0]Output70%
ARVALIDM0Output70%
AWADDRM0[31:0]Output70%
AWBURSTM0[1:0]Output70%
AWCACHEM0[3:0]Output70%
AWIDM0[7:0]Output70%
AWLENM0[3:0]Output70%
AWLOCKM0[1:0]Output70%
AWPROTM0[2:0]Output70%
AWREADYM0Input50%
AWSIZEM0[2:0]Output70%
AWUSERM0[7:0]Output70%
AWVALIDM0Output70%
BIDM0[7:0]Input50%
BREADYM0Output70%
BRESPM0[1:0]Input50%
BVALIDM0Input50%
INCLKENM0Input30%
OUTCLKENM0Output30%
RDATAM0[63:0]Input50%
RIDM0[7:0]Input50%
RLASTM0Input50%
RREADYM0Output70%
RRESPM0[1:0]Input50%
RVALIDM0Input50%
WDATAM0[63:0]Output70%
WIDM0[7:0]Output70%
WLASTM0Output70%
WREADYM0Input50%
WSTRBM0[7:0]Output70%
WVALIDM0Output70%